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对比文件列表
| 编号 | 名称 |
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| 0 | 1981-07-21_US4280221A_发明授权_US4280221A Digital data communication system_+++b_h_j+++.docx |
| 0 | 1987-02-17_US4644547A_发明授权_US4644547A Digital message format for two-way communication and control network.docx |
| 0 | 1989-06-13_US4839907A_发明授权_US4839907A Clock skew correction arrangement.docx |
| 0 | 1992-11-12_WO1992020026A_发明申请_WO1992020026A1 KNOWLEDGE BASED RESOURCE MANAGEMENT.docx |
| 0 | 1994-09-13_None_发明专利_JPH06256741A Hot-melt adhesive_+++A_a+++.docx |
| 0 | 1996-02-20_US5493538A_发明授权_US5493538A Minimum pulse width address transition detection circuit.docx |
| 0 | 1997-12-30_US5703914A_发明授权_US5703914A Clock recovery circuit employing delay-and-difference circuit and pulse-sequence detection.docx |
| 0 | 1999-01-19_US5862180A_发明授权_US5862180A Differential encoding of self-clocking data streams.docx |
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| 0 | 2001-04-27_JP2001119382A_发明专利_JP2001119382A Clock signal extracting circuit, parallel digital interface having the same, clock signal extracting method and parallel data bit signal synchronizing metho.docx |
| 0 | 2001-11-20_US6320406B_发明授权_US06320406B1 Methods and apparatus for a terminated fail-safe circuit.docx |
| 0 | 2001-11-20_US6320437B_发明授权_US06320437B1 Duty cycle regulator.docx |
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| 0 | 2003-02-25_US6526112B_发明授权_US06526112B1 System for clock and data recovery for multi-channel parallel data streams.docx |
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| 0 | 2003-07-14_JP3425905B_发明专利_JP3425905B2 Synchronization method of parallel digital interface, as well as parallel data bit signal having a method and it clock signal extraction with clock signal extrac.docx |
| 0 | 2003-09-23_US6624766B_发明授权_US06624766B1 Recovery and transmission of return-to-zero formatted data using non-return-to-zero devices.docx |
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| 0 | 2011-10-13_US2011249781A_发明申请_US20110249781A1 DEVICE FOR RECONSTRUCTING THE CLOCK OF AN NRZ SIGNAL, AND ASSOCIATED TRANSMISSION SYSTEM.docx |
| 0 | 2012-01-26_US2012020660A_发明申请_US20120020660A1 METHOD OF AND SYSTEM FOR DETECTING SKEW BETWEEN PARALLEL SIGNALS.docx |
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| 0 | 2012-08-22_JP5006854B_发明专利_JP5006854B2 Working machine.docx |
| 0 | 2012-08-23_US2012213299A_发明申请_US20120213299A1 METHODS AND SYSTEMS FOR NOISE RESILIENT, PIN-EFFICIENT AND LOW POWER COMMUNICATIONS WITH SPARSE SIGNALING CODES_+++G_K_M_S_T_U_V_W_X_Y_h_i_j+++.docx |
| 0 | 2012-09-06_US2012224656A_发明申请_US20120224656A1 SIGNAL WIRING SYSTEM AND JITTER SUPPRESSION CIRCUIT.docx |
| 0 | 2012-09-11_US8264253B_发明授权_US08264253B2 Transmitter swing control circuit and method_+++B_C_D_h_k+++.docx |
| 0 | 2012-09-27_JP2012185494A_发明专利_JP2012185494A Charging member, method for manufacturing the same, process cartridge and electrophotographic apparatus.docx |
| 0 | 2012-10-03_JP5042962B_发明专利_JP5042962B2 Non-volatile memory device and a method for manufacturing the same.docx |
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| 0 | 2012-10-10_JP5043960B_发明专利_JP5043960B2 3-phase and polarity encoded serial interface_+++A_H_J_K_b_n+++.docx |
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权利要求1
一种用于差分信号发射机的端接网络电路，包括： n个电阻元件，其中所述n个电阻元件中的每一个电阻元件的第一端一起在公共节点处耦合到所述n个电阻元件中的每一个其他电阻元件的第一端，其中n是整数值并且n个导体被用来传送多个差分信号；以及多个差分信号驱动器，每一差分信号驱动器包括正端子驱动器和负端子驱动器，其中对于每一差分信号驱动器，所述正端子驱动器和所述负端子驱动器分别耦合至第一电阻元件和第二电阻元件的配对，其中所述正端子驱动器耦合到所述配对的第一电阻元件的第二端，而所述负端子驱动器耦合到所述配对的第二电阻元件的第二端，其中所述n个电阻元件中的每一个电阻元件连接至所述多个差分信号驱动器中的两个或更多个差分信号驱动器，并且其中所述多个差分信号驱动器中的每个差分信号驱动器连接到所述n个电阻元件中的第一电阻元件和第二电阻元件的不同配对，其中所述正端子驱动器和所述负端子驱动器能分开且独立地切换以提供具有幅值和方向的电流。
权利要求2
如权利要求1所述的端接网络电路，其特征在于，所有电阻元件都具有相同的电阻值。
权利要求3
如权利要求1所述的端接网络电路，其特征在于，在所述多个差分信号的传输循环期间，所述n个电阻元件中的每一个具有与其他电阻元件不同的幅值和/或方向的电流。
权利要求4
如权利要求1所述的端接网络电路，其特征在于，在传输循环期间耦合到所述n个电阻元件的所述多个差分信号的组合具有非零电压差分。
权利要求5
如权利要求1所述的端接网络电路，其特征在于，n＝>3。
权利要求6
如权利要求1所述的端接网络电路，其特征在于，所述多个差分信号是从原始码元子集生成的，所述原始码元子集选自多个可能原始码元，所述原始码元子集等于在所述端接网络电路处生成非零电压差分的n！个状态。
权利要求7
如权利要求1所述的端接网络电路，其特征在于，所述正端子驱动器和所述负端子驱动器之一被选择性地关闭以消除跨电阻元件的电流抵消。
权利要求8
如权利要求1所述的端接网络电路，其特征在于，所述多个差分信号驱动器之间的电路径只经过所述n个电阻元件以及所述公共节点。
权利要求9
如权利要求1所述的端接网络电路，其特征在于，对于n＝3个导体，使用3个差分信号驱动器以及2个差分电压电平来在每循环传送6个状态。
权利要求10
如权利要求1所述的端接网络电路，其特征在于，对于n＝4个导体，使用6个差分信号驱动器以及3个差分电压电平来在每循环传送24个状态。
权利要求11
如权利要求1所述的端接网络电路，其特征在于，对于n＝5个导体，使用10个差分信号驱动器以及4个差分电压电平来在每循环传送120个状态。
权利要求12
如权利要求1所述的端接网络电路，其特征在于，对于n＝6个导体，使用15个差分信号驱动器以及5个差分电压电平来在每循环传送720个状态。
权利要求13
如权利要求1所述的端接网络电路，其特征在于，每一个正端子驱动器以及每一个负端子驱动器包括多个可切换电路，每一可切换电路独立于同一正/负端子驱动器中的其他可切换电路来控制。
权利要求14
如权利要求13所述的端接网络电路，其特征在于，每一可切换电路包括导致电流流出相应的正/负端子驱动器的第一开关、以及导致电流流入相应的正/负端子驱动器的第二开关。
权利要求15
如权利要求13所述的端接网络电路，其特征在于，所述多个可切换电路包括提供去往/来自相应端子的第一电流的第一可切换电路以及提供去往/来自相应端子的第二电流的第二可切换电路。
权利要求16
如权利要求15所述的端接网络电路，其特征在于，所述第二电流具有与所述第一电流不同的幅值但相同的方向。
权利要求17
如权利要求15所述的端接网络电路，其特征在于，所述第二电流是所述第一电流的整数倍。
权利要求18
如权利要求15所述的端接网络电路，其特征在于，所述多个可切换电路还包括提供去往/来自相应端子的第三电流的第三可切换电路，其中所述第二电流相比于所述第一电流具有固定增量，而所述第三电流相比于所述第二电流具有相同的固定增量。
权利要求19
如权利要求15所述的端接网络电路，其特征在于，可切换电路的幅值和/或数量是所使用的导体数量的函数。
权利要求20
一种用于在用于差分信令的端接网络中节省功率的方法，包括： 在公共节点处将n个电阻元件中的每一个电阻元件的第一端耦合到所述n个电阻元件中的每一个其他电阻元件的第一端，其中n是整数值并且n个导体被用来传送多个差分信号； 将多个差分信号驱动器中的每一个拆分成正端子驱动器和负端子驱动器； 其中对于每一差分信号驱动器，将所述正端子驱动器和所述负端子驱动器分别耦合至第一电阻元件和第二电阻元件的配对，其中所述正端子驱动器耦合到所述配对的第一电阻元件的第二端且所述负端子驱动器耦合到所述配对的第二电阻元件的第二端，其中所述n个电阻元件中的每一个电阻元件连接至所述多个差分信号驱动器中的两个或更多个差分信号驱动器，并且其中所述多个差分信号驱动器中的每个差分信号驱动器连接到所述n个电阻元件中的第一电阻元件和第二电阻元件的不同配对，其中所述正端子驱动器和所述负端子驱动器能分开且独立地切换以提供具有幅值和方向的电流。
权利要求21
如权利要求20所述的方法，其特征在于，所有电阻元件都具有相同的电阻值。
权利要求22
如权利要求20所述的方法，其特征在于，在所述多个差分信号的传输循环期间，所述n个电阻元件中的每一个具有与其他电阻元件不同的幅值和/或方向的电流。
权利要求23
如权利要求20所述的方法，其特征在于，在传输循环期间耦合到所述n个电阻元件的所有所述多个差分信号的组合具有非零电压差分。
权利要求24
如权利要求20所述的方法，其特征在于，n＝>3。
权利要求25
如权利要求20所述的方法，其特征在于，所述多个差分信号是从原始码元子集生成的，所述原始码元子集选自多个可能原始码元，所述原始码元子集等于在端接网络处生成非零电压差分的n！个状态。
权利要求26
如权利要求20所述的方法，其特征在于，所述正端子驱动器和所述负端子驱动器之一被选择性地关闭以消除跨电阻元件的电流抵消。
权利要求27
如权利要求20所述的方法，其特征在于，所述多个差分信号驱动器之间的电路径只经过所述n个电阻元件以及所述公共节点。
权利要求28
如权利要求20所述的方法，其特征在于，对于n＝3个导体，使用3个差分信号驱动器以及2个差分电压电平来在每循环传送6个状态。
权利要求29
如权利要求20所述的方法，其特征在于，对于n＝4个导体，使用6个差分信号驱动器以及3个差分电压电平来在每循环传送24个状态。
权利要求30
如权利要求20所述的方法，其特征在于，对于n＝5个导体，使用10个差分信号驱动器以及4个差分电压电平来在每循环传送120个状态。
权利要求31
如权利要求20所述的方法，其特征在于，对于n＝6个导体，使用15个差分信号驱动器以及5个差分电压电平来在每循环传送720个状态。
权利要求32
如权利要求20所述的方法，其特征在于，每一个正端子驱动器以及每一个负端子驱动器包括多个可切换电路，每一可切换电路独立于同一正/负端子驱动器中的其他可切换电路来控制。
权利要求33
如权利要求32所述的方法，其特征在于，每一可切换电路包括导致电流流出相应的正/负端子驱动器的第一开关、以及导致电流流入相应的正/负端子驱动器的第二开关。
权利要求34
如权利要求32所述的方法，其特征在于，所述多个可切换电路包括提供去往/来自相应端子的第一电流的第一可切换电路以及提供去往/来自相应端子的第二电流的第二可切换电路。
权利要求35
如权利要求34所述的方法，其特征在于，所述第二电流具有与所述第一电流不同的幅值但相同的方向。
权利要求36
如权利要求34所述的方法，其特征在于，所述多个可切换电路还包括提供去往/来自相应端子的第三电流的第三可切换电路，其中所述第二电流相比于所述第一电流具有固定增量，而所述第三电流相比于所述第二电流具有相同的固定增量。