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对比文件列表
2001-04-13_JP2001102696A_发明专利_JP2001102696A Wiring board and manufacturing method therefor_+++A_B_C_D_E_J_M_N_O_Y_Z_k_l+++.docx
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2004-07-08_JP2004193168A_发明专利_JP2004193168A Wiring board and its manufacturing method_+++A_B_C_D_E_J_M_N_O_Y_Z_f_g_h_i_k_l_p+++.docx
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2004-08-12_US2004154930A_发明申请_US20040154930A1 Copper foil for high frequency circuit and method of production of same_+++B_C_D_e+++.docx
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2004-11-18_US2004229024A_发明申请_US20040229024A1 Multi-layer printed circuit board and method for manufacturing the same_+++A_B_C_D_e+++.docx
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2005-07-06_JP3669284B_发明专利_JP3669284B2 ink cartridge_+++B_C_D_E_a+++.docx
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2007-04-16_TW200715919A_发明专利_TW200715919A 二層軟性電路板 DUAL-LAYERED FLEXIBLE CIRCUIT BOARD_+++A_B_C_D_R_S_T_U_V_W_e_j_m_n_o_x+++.docx
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2008-03-05_KR1020080020077A_发明公开_KR1020080020077A 고밀도 인쇄회로기판 및 그 제조 방법_+++A_B_C_D_R_T_U_V_e_m_n_o_x+++.docx
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2009-05-19_US7535095B_发明授权_US07535095B1 Printed wiring board and method for producing the same_+++A_B_C_D_E_R_S_T_U_V_W_X+++.docx
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2010-06-11_KR1020100063526A_发明公开_KR1020100063526A 인쇄회로기판 제조방법_+++A_B_C_D_E_R_S_T_U_V_W_X_j_m_n_o+++.docx
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2012-06-21_US2012152594A_发明申请_US20120152594A1 REDUCED CIRCUIT TRACE ROUGHNESS FOR IMPROVED SIGNAL PERFORMANCE_+++A_B_C_D_E_J_K_f_h_i_p+++.docx
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2013-10-29_US8568856B_发明授权_US08568856B2 Two-layer flexible substrate_+++A_B_R_S_T_U_V_W_c_d_e_x+++.docx
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2014-05-19_JP2014093355A_发明专利_JP2014093355A Method for manufacturing printed-wiring board_+++A_B_C_D_R_S_T_U_e_j_m_n_o_v_w_x+++.docx
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2014-07-03_US2014186651A_发明申请_US20140186651A1 PRINTED CIRCUIT BOARD HAVING COPPER PLATED LAYER WITH ROUGHNESS AND METHOD OF MANUFACTURING THE SAME_+++A_B_C_D_F_K_P_R_S_T_U_V_e_h_i_j_m_n_o_w_x+++.docx
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2014-07-08_KR1020140086523A_发明公开_KR1020140086523A 조도가 형성된 동도금층을 구비한 인쇄회로기판 및 이의 제조방법_+++A_B_C_D_E_F_H_I_K_P_R_S_T_U_V_W_j_m_n_o_x+++.docx
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2015-01-15_JP2015008260A_发明专利_JP2015008260A 高周波用プリント配線板_+++A_B_C_D_e+++.docx
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2015-01-15_US2015014027A_发明申请_US20150014027A1 WIRING BOARD AND METHOD FOR MANUFACTURING THE SAME_+++A_B_C_D_E_F_K_P_Z_j_m_n_o+++.docx
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2016-08-08_KR1020160093403A_发明公开_KR1020160093403A 전자파차폐구조물_+++A_b_c_d_e_k_r_s_t_u_v_w_x+++.docx
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2016-12-06_US9516765B_发明授权_US09516765B2 Method for producing printed wiring board_+++A_B_C_D_E_R_S_T_U_V_W_X+++.docx
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2017-05-04_US2017127519A_发明申请_US20170127519A1 CIRCUIT BOARD AND METHOD FOR MANUFACTURING SAME_+++A_B_C_D_E_J_M_N_O_R_S_T_U_V_W_X_Z_y+++.docx
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2017-09-22_KR1020170107040A_发明公开_KR1020170107040A 조면화 처리 구리박 및 프린트 배선판_+++A_B_C_D_E_J_M_N_O+++.docx
2026-07-03 01:04
2017-10-19_JP2017191894A_发明专利_JP2017191894A プリント配線基板及びその製造方法_+++A_B_C_D_R_S_T_U_e_v_w_x+++.docx
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2017-10-19_US2017303394A_发明申请_US20170303394A1 PRINTED WIRING BOARD AND METHOD FOR MANUFACTURING THE SAME_+++A_B_C_D_E_F_H_P_R_S_T_U_V_W_X_j_m_n_o+++.docx
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2018-01-18_JP2018010931A_发明专利_JP2018010931A 配線基板及びその製造方法_+++A_B_C_D_E_K_f_h_i_j_m_n_o+++.docx
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US10170405B2_Description_20260619_1134_+++A_B_C_D_E_J_K_L_M_N_O_f_h_i_p+++.docx
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2004-08-12_US2004154930A_发明申请_US20040154930A1 Copper foil for high frequency circuit and method of production of same_+++B_C_D_e+++.docx

在回答的开始,明确以下信息:

- **对比文件名称**:2004-08-12_US2004154930A_发明申请_US20040154930A1 Copper foil for high frequency circuit and method of production of same

- **目标专利名称**:1558印刷电路板CN113243145B

- **本次调用的模型名称**:Claude 3.5 Sonnet

以下是根据要求构建的**特征比对表格**,并逐项判断各技术特征是否被对比文件直接公开或隐含公开。表格中第一栏记录技术特征及判断结果,第二栏引用对比文件原文(已翻译成中文,并标注段落编号),第三栏进行公开性论述。

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### 特征比对表格

第一栏:技术特征描述及公开性判断第二栏:对比文件原文引用(翻译)第三栏:公开性论述
技术特征A:包括《未公开》无直接对应内容。对比文件主要涉及高频电路用铜箔及其制造方法,未明确记载“包括”这一权利要求的过渡词,也未记载“印刷电路板”这一完整产品主题。特征A是权利要求中的开放式过渡词“包括”,无具体技术含义。对比文件仅公开了铜箔产品及用于印刷电路,但未公开印刷电路板本身的结构组成。即使采用宽松的隐含公开标准,也无法合理推断出对比文件公开了“包括”这一形式特征。因此,特征A未被公开。
技术特征B:绝缘层《直接公开》[0005] “…the surface bonded with a resin substrate (hereinafter called the ‘matte side’).” (译为:与树脂基板结合的表面(以下称为糙面)。)对比文件明确提到“树脂基板”(resin substrate),该树脂基板即为印刷电路板中的绝缘层。在对比文件的上下文中,树脂基板用作铜箔的支撑和绝缘体,本领域技术人员可直接、毫无疑义地确定其相当于目标专利中的绝缘层。因此,特征B被直接公开。
技术特征C:电路图案《直接公开》[0002] “The present invention relates to a copper foil … suitable for a conductive material of printed circuits for high frequency applications.” (译为:本发明涉及一种铜箔,特别适合作为高频用途印刷电路的导电材料。)对比文件明确指出铜箔用于印刷电路的导电材料。印刷电路的导电材料即构成电路图案。本领域技术人员可直接理解该导电材料最终通过蚀刻等工艺形成电路图案。因此,特征C被直接公开。
技术特征D:所述电路图案设置于所述绝缘层上《直接公开》[0005] “…the surface bonded with a resin substrate …” (译为:与树脂基板结合的表面。)<br>[0037] “Next, production conditions for the electrodeposited copper foil and examples of surface treatment of an untreated copper foil using it as an untreated copper foil will be shown.” (本段及后续实施例显示铜箔与树脂基板的结合。)对比文件反复教导铜箔(电路图案的原材料)与树脂基板(绝缘层)结合。结合方式通常为层压,使得铜箔直接设置于绝缘层上。这种设置关系是毫无争议的。因此,特征D被直接公开。
技术特征E:其中,所述电路图案包括上表面、下表面、第一侧表面和第二侧表面《隐含公开》[0005] “…the surface bonded with a resin substrate (hereinafter called the ‘matte side’).” (指明糙面为一个主要表面。)<br>[0006] “…the shiny side surface and the matte side surface.” (提及光面和糙面。)对比文件具体区分了铜箔的“光面”(shiny side)和“糙面”(matte side),分别对应电路图案的上表面和下表面。虽然对比文件未明确命名“侧表面”,但是在铜箔或电路图案的几何结构中,必然存在连接上下表面的侧壁。本领域技术人员在阅读对比文件后,根据常识可以合理推断出电路图案具有四个表面(上、下、第一侧、第二侧)。因此,特征E被隐含公开。
技术特征F:所述电路图案的所述上表面、所述下表面、所述第一侧表面和所述第二侧表面中的至少三个表面的表面粗糙度(Ra)为0.31μm以下《未公开》[0009] TABLE 1 显示粗糙度为Rz值(未处理箔1.70μm、1.12μm等;粗糙化后1.99μm、1.33μm等)<br>[0040] TABLE 4 显示糙面粗糙度(matte side)为2.4~3.6μm,光面(shiny side)为1.5μm(均为Rz)。对比文件全文均以Rz(十点平均高度)表征粗糙度,从未提及Ra(算术平均粗糙度)。特征F限定的Ra≤0.31μm是一个具体的参数范围,对比文件中未能给出任何Ra数值,也未给出Rz与Ra的换算关系。即使考虑最光滑的比较例D(糙面Rz 0.8μm),也无法直接或隐含地确定其Ra≤0.31μm,更遑论至少三个表面满足该数值。此外,对比文件未涉及侧表面的粗糙度。因此,特征F未被公开。
技术特征G:其中,在所述电路图案的表面中长度长的部分的粗糙度小于长度小的部分的粗糙度《未公开》无对应内容。对比文件主要讨论铜箔两个主表面的粗糙度差异及粗糙化处理强度,没有提出基于表面长度大小来决定粗糙度大小的任何教导或暗示。本领域技术人员无法从对比文件中合理推断出该特征。因此,特征G未被公开。
技术特征H:其中,所述电路图案的所述上表面、所述下表面、所述第一侧表面和所述第二侧表面中的至少三个表面的表面粗糙度(Ra)为0.17μm以下《未公开》同特征F,对比文件未涉及Ra值,且数值范围远大于0.17μm。对比文件无任何内容公开Ra≤0.17μm的数值范围,也没有证据表明其公开的Rz值能经换算落入该范围。更关键的是,对比文件未提及至少三个表面的要求。因此,特征H未被公开。
技术特征I:其中,所述电路图案的所述上表面、所述下表面、所述第一侧表面和所述第二侧表面中的至少三个表面的表面粗糙度(Ra)为0.1μm至0.13μm《未公开》同特征F。该特征限定了更窄的Ra范围,对比文件中没有任何内容涉及。因此,特征I未被公开。
技术特征J:其中,所述电路图案的宽度方向上的横截面中的所述上表面的长度和所述下表面长度中的至少一个与所述电路图案的所述横截面中的所述第一侧表面的长度和所述第二侧表面的长度中的至少一个不同《未公开》无对应内容。对比文件只涉及铜箔的平面粗糙度和剥离强度,未分析电路图案的横截面尺寸关系。本领域技术人员无法从对比文件中推断出上表面/下表面长度与侧表面长度不同。因此,特征J未被公开。
技术特征K:其中,所述电路图案的所述上表面和所述下表面中的至少一个的表面粗糙度(Ra)与所述电路图案的所述第一侧表面和所述第二侧表面中的至少一个的表面粗糙度(Ra)不同《未公开》[0040] TABLE 4 显示shiny side粗糙度(光面)为1.5μm,matte side粗糙度(糙面)为2.4~3.6μm(均为Rz)。对比文件仅公开了上下两个主表面(光面/糙面)的粗糙度不同,但特征K要求的是上表面和/或下表面与侧表面的粗糙度不同。对比文件没有记载侧表面的粗糙度数据,也没有任何比较。本领域技术人员无法合理推断侧表面粗糙度与主表面的关系。因此,特征K未被公开。
技术特征L:其中,所述电路图案的所述横截面中的所述上表面的长度和所述下表面的长度中的至少一个大于所述电路图案的所述横截面中的所述第一侧表面的长度和所述第二侧表面的长度中的至少一个;并且中,所述电路图案的所述上表面和所述下表面中的至少一个的表面粗糙度(Ra)小于所述电路图案的所述第一侧表面和所述第二侧表面中的至少一个的表面粗糙度(Ra)《未公开》无对应内容。对比文件既没有教导横截面中长度大小关系,也没有基于此调节表面粗糙度的技术启示。整个特征L涉及多层关联,对比文件中完全缺失。因此,特征L未被公开。
技术特征M:其中,所述上表面的长度是所述上表面的宽度《未公开》无对应内容。对比文件未定义或暗示上表面长度与宽度的关系。因此,特征M未被公开。
技术特征N:其中,所述下表面的长度是所述下表面的宽度《未公开》无对应内容。对比文件未定义或暗示下表面长度与宽度的关系。因此,特征N未被公开。
技术特征O:所述第一侧表面的长度和所述第二侧表面的长度是所述电路图案的高度《未公开》无对应内容。对比文件未提及侧表面长度与电路图案高度的对应关系。因此,特征O未被公开。
技术特征P:其中,所述电路图案的所述上表面、所述下表面、所述第一侧表面和所述第二侧表面中的至少三个表面的表面粗糙度(Ra)为0.42μm以下《未公开》同特征F。特征P中的Rq(均方根粗糙度)参数同样未在对比文件中出现。对比文件仅有Rz值,且无Rq数据。即使Rz与Rq存在统计关系,对比文件也未提供任何依据使得本领域技术人员能毫无疑义地得出Rq≤0.42μm。因此,特征P未被公开。
技术特征Q:其中,所述电路图案的阻抗为35.3Ω以下《未公开》[0056] TABLE 8 显示传输损耗(transmission loss)数值,未涉及阻抗值。对比文件测量的是传输损耗(dB/m),未公开电路图案的阻抗参数。特征Q中的阻抗值35.3Ω来自目标专利的具体实验数据,对比文件中不存在。因此,特征Q未被公开。
技术特征R:其中,所述电路图案包括:电镀种子层《未公开》对比文件提及“electrodeposited copper foil”(电沉积铜箔)、“roughening treating”、“encapsulation plating”(封装电镀)等,但未区分电镀种子层。目标专利的“电镀种子层”是作为后续电镀的基层,独立于主体图案层。对比文件的铜箔整体由电沉积形成,没有独立的种子层结构。虽然对比文件有封装电镀层,但其作用不同且不是必要的种子层。因此,特征R未被公开。
技术特征S:所述电镀种子层设置在所述绝缘层上《未公开》无对应结构描述。由于特征R未公开,该特征也随之未被公开。对比文件未涉及种子层在绝缘层上的设置关系。因此,特征S未被公开。
技术特征T:图案层《未公开》对比文件中的铜箔主体可视为一层,但未明确该层为“图案层”。对比文件的铜箔是完整的导电层,需要通过后续蚀刻形成图案,但对比文件未专门定义“图案层”作为与种子层分离的结构层。因此,特征T未被公开。
技术特征U:所述图案层设置在所述电镀种子层上《未公开》无对应描述。由于种子层和图案层均未公开,该特征未被公开。
技术特征V:其中,所述电路图案的所述上表面是所述图案层的上表面《未公开》无对应描述。对比文件未区分图案层上表面。因此,特征V未被公开。
技术特征W:其中,所述电路图案的所述下表面是所述电镀种子层的下表面《未公开》无对应描述。对比文件未公开种子层及其下表面的概念。因此,特征W未被公开。
技术特征X:其中,所述电路图案的所述第一侧表面包括所述电镀种子层的第一侧表面和所述图案层的第一侧表面;并且中,所述电路图案的所述第二侧表面包括所述电镀种子层的第二侧表面和所述图案层的第二侧表面《未公开》无对应描述。对比文件未涉及两层结构的侧表面组成。因此,特征X未被公开。
技术特征Y:其中,所述电路图案的宽度方向上的横截面中的所述上表面的长度小于所述电路图案的所述宽度方向上的所述横截面中的所述下表面的长度《未公开》无对应内容。对比文件未讨论电路图案横截面上表面与下表面的长度关系。因此,特征Y未被公开。
技术特征Z:其中,所述电路图案的所述宽度方向上的所述横截面中的所述第一侧表面和所述第二侧表面中的至少一个具有规定的倾斜角度并且连接在所述电路图案的所述上表面和所述下表面之间《未公开》无对应内容。对比文件未涉及电路图案侧表面的倾斜角度。因此,特征Z未被公开。

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### 输出代码

根据上述判断,以下特征被**直接公开**:B、C、D

以下特征被**隐含公开**:E

其余特征均未被公开(既不直接也不隐含)。

因此,在回答结尾插入对应的代码:

<<<B>>><<<C>>><<<D>>><<<e>>>

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