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2003-04-29_US6556628B_发明授权_US06556628B1 Methods and systems for transmitting and receiving differential signals over a plurality of conductors_+++A_B_C_D_E_F_H_I_J_K_L_N_O_P_Q_R+++.docx
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2005-03-10_US2005053171A_发明申请_US20050053171A1 Systems for data transmission_+++A_G_K_j_l_n_o+++.docx
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2006-04-06_JP2006093988A_发明专利_JP2006093988A Encoder and decoder_+++K_O+++.docx
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2007-01-18_WO2007009038A_发明申请_WO2007009038A2 INTERFACE FOR A MULTI-DIFFERENTIAL COMMUNICATION CHANNEL_+++K+++.docx
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2007-10-18_US2007241836A_发明申请_US20070241836A1 Efficient Wired Interface For Differential Signals_+++E_F_H_K_b_g_i_j+++.docx
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2008-04-15_US7358869B_发明授权_US07358869B1 Power efficient, high bandwidth communication using multi-signal-differential channels_+++A_B_G_H_K_N_c_d_f_i_j+++.docx
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2009-01-08_WO2008109478A_发明申请_WO2008109478A2 THREE PHASE AND POLARITY ENCODED SERIAL INTERFACE_+++A_B_C_D_E_F_G_H_K_N_i_j_l_m+++.docx
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2009-07-09_WO2009086078A_发明申请_WO2009086078A1 RECEIVER FOR MULTI-WIRE COMMUNICATION WITH REDUCED INPUT CAPACITANCE_+++A_K_b_c_d_e_f_g_h_i_j_n+++.docx
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2009-07-09_WO2009086142A_发明申请_WO2009086142A1 ASYMMETRIC COMMUNICATION ON SHARED LINKS_+++A_K+++.docx
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2009-07-22_GB2456517A_发明专利_GB2456517A Serial data communication circuit for use with transmission lines using both data and clock to enable recovery of data synchronously_+++k+++.docx
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2009-08-06_US2009195699A_发明申请_US20090195699A1 MULTIPLE DIFFERENTIAL TRANSMISSION SYSTEM_+++K_h_i_j+++.docx
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2009-11-10_KR1020090115977A_发明公开_KR1020090115977A 3-위상 및 극성 인코딩된 직렬 인터페이스_+++A_D_G_H_J_K_N_b_c_e_f_i+++.docx
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2009-12-30_CN101617494A_发明公开_CN101617494A 三相极性编码串行接口_+++A_H_K+++.docx
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2010-02-18_US2010040169A_发明申请_US20100040169A1 CODING METHODS AND SYSTEMS FOR IMPROVED ERROR MARGINS_+++k+++.docx
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2010-02-24_EP2156555A_发明公开_EP2156555A1 TECHNIQUES FOR MULTI-WIRE ENCODING WITH AN EMBEDDED CLOCK_+++A_B_G_H_K_c_d+++.docx
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2010-06-10_JP2010520715A_发明专利_JP2010520715A 3-phase and polarity encoded serial interface_+++A_B_C_D_E_F_G_H_I_J_K_N_l_o+++.docx
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2010-07-15_US2010180143A_发明申请_US20100180143A1 TECHNIQUES FOR IMPROVED TIMING CONTROL OF MEMORY DEVICES_+++K+++.docx
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2010-09-29_EP2232377A_发明公开_EP2232377A1 ASYMMETRIC COMMUNICATION ON SHARED LINKS_+++A_K_h_i_j+++.docx
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2010-12-09_US2010309964A_发明申请_US20100309964A1 ASYMMETRIC COMMUNICATION ON SHARED LINKS_+++K_a+++.docx
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2011-02-10_JP2011029779A_发明专利_JP2011029779A Transmitter, and communication system_+++K+++.docx
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2011-07-19_US7983347B_发明授权_US07983347B2 Multiple differential transmission system including signal transmitter and signal receiver connected via three signal lines_+++K_b_e_f_j_l_o+++.docx
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2012-02-08_EP2232377B_发明授权_EP2232377B1 ASYMMETRIC COMMUNICATION ON SHARED LINKS_+++H_K_a_b_e_f+++.docx
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2012-04-17_US8159376B_发明授权_US08159376B2 Encoding and decoding techniques for bandwidth-efficient communication_+++K+++.docx
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2012-06-21_US2012155565A_发明申请_US20120155565A1 Three phase and polarity encoded serial interface_+++A_H_K_L_e_f_g_j_n_o+++.docx
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2012-08-23_US2012213299A_发明申请_US20120213299A1 METHODS AND SYSTEMS FOR NOISE RESILIENT, PIN-EFFICIENT AND LOW POWER COMMUNICATIONS WITH SPARSE SIGNALING CODES_+++G_K_M_S_T_U_V_W_X_Y_h_i_j+++.docx
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2012-09-11_US8264253B_发明授权_US08264253B2 Transmitter swing control circuit and method_+++B_C_D_h_k+++.docx
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2012-10-09_US8284848B_发明授权_US08284848B2 Differential data transferring system and method using three level voltages_+++K+++.docx
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2012-10-10_JP5043960B_发明专利_JP5043960B2 3-phase and polarity encoded serial interface_+++A_H_J_K_b_n+++.docx
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US2006006902A1_Description_20260318_1941_+++B_C_D_F_h_k+++.docx
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US2008212709A1_Description_20260318_1940_+++A_E_F_H_J_K_N_b_c_d_g_i+++.docx
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US2010215118A1_Description_20260318_1940_+++H_K+++.docx
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US2006061494A1_Description_20260318_1941_+++B_C_D_E_F_K_O+++.docx

**对比文件名称**:US2006061494A1_Description_20260318_1941

**目标专利名称**:高效N阶乘差分信令端接网络CN105009533B

**本次调用模型名称**:未提供

### **特征比对表格**

技术特征描述以及公开性判断结果对比文件原文引用公开性论述
**技术特征A《未公开》**<br>包括:n个电阻元件,其中所述n个电阻元件中的每一个电阻元件的第一端一起在公共节点处耦合到所述n个电阻元件中的每一个其他电阻元件的第一端,其中n是整数值并且n个导体被用来传送多个差分信号对比文件图26及对应说明:[0269] “FIG. 26 shows the structure of the differential driver circuit... The differential driver circuit designated by reference numeral 50 has three differential line drivers 51A, 51B, and 51C, six resistors 52A, 52B, and 52C, and resistors 53A, 53B, and 53C.”**论述**:目标专利的特征A要求所有电阻元件的第一端在**一个公共节点**处耦合,形成星形网络。对比文件图26的差分驱动器电路50采用三角形(△)端接网络,电阻(52A、52B、52C、53A、53B、53C)连接在三个输出端子之间,而不是所有电阻的一端连接到一个公共节点。因此,对比文件未公开电阻在单一公共节点耦合的星形拓扑结构,既未直接公开也未隐含公开该技术特征。
**技术特征B《直接公开》**<br>多个差分信号驱动器,每一差分信号驱动器包括正端子驱动器和负端子驱动器,对比文件图26及对应说明:[0269] “FIG. 26 shows the structure of the differential driver circuit... The differential driver circuit designated by reference numeral 50 has three differential line drivers 51A, 51B, and 51C...”**论述**:目标专利的特征B限定了差分信号驱动器的构成。对比文件图26明确公开了三个差分线路驱动器(differential line drivers)51A、51B和51C。一个差分驱动器必然包含用于输出差分信号的正端子和负端子。因此,本领域技术人员能够毫无疑义地得出对比文件公开了“多个差分信号驱动器,每一差分信号驱动器包括正端子驱动器和负端子驱动器”这一技术特征。
**技术特征C《直接公开》**<br>其中对于每一差分信号驱动器,所述正端子驱动器和所述负端子驱动器分别耦合至第一电阻元件和第二电阻元件的配对,对比文件图26:[0269] 图中显示每个差分驱动器(如51A)的正输出端子和负输出端子分别通过一个电阻(如53A和52B)连接到输出端子(如Or)。**论述**:目标专利的特征C限定了每个驱动器的正负端子分别耦合到一对电阻元件。对比文件图26的电路连接清晰显示,对于每个差分驱动器(例如51A),其正输出端子通过一个电阻(53A)连接,其负输出端子通过另一个电阻(52B)连接,这构成了一对电阻元件(53A和52B)。因此,该技术特征被对比文件直接公开。
**技术特征D《直接公开》**<br>其中所述正端子驱动器耦合到所述配对的第一电阻元件的第二端,而所述负端子驱动器耦合到所述配对的第二电阻元件的第二端,对比文件图26:[0269] 图中明确显示了驱动器51A的正输出端子连接到电阻53A的一端(第二端),驱动器51A的负输出端子连接到电阻52B的一端(第二端)。电阻53A和52B的另一端共同连接到输出端子Or。**论述**:目标专利的特征D进一步限定了正负端子与电阻连接的具体端点。对比文件图26的电路图直接、明确地展示了该连接关系:每个驱动器的正端子连接到其对应配对中一个电阻的一端,负端子连接到另一个电阻的一端。因此,本领域技术人员能毫无疑义地得出该技术特征。
**技术特征E《直接公开》**<br>其中所述n个电阻元件中的每一个电阻元件连接至所述多个差分信号驱动器中的两个或更多个差分信号驱动器,对比文件图26:[0269] 在三角形端接网络中,每个电阻(如52A)连接在两个输出端子之间,而每个输出端子连接有两个驱动器的输出(例如端子Or连接有驱动器51A的正输出和驱动器51B的负输出)。因此,每个电阻实质上连接到了两个不同的驱动器。**论述**:目标专利的特征E要求每个电阻元件连接到两个或更多个驱动器。对比文件图26的三角形网络结构中,每个电阻连接在两个输出节点之间。由于每个输出节点由两个不同驱动器的正或负端子驱动(通过电阻),因此流过每个电阻的电流由两个驱动器的输出共同决定。这等同于每个电阻元件在电气上连接到两个差分信号驱动器。该特征被直接公开。
**技术特征F《直接公开》**<br>并且其中所述多个差分信号驱动器中的每个差分信号驱动器连接到所述n个电阻元件中的第一电阻元件和第二电阻元件的不同配对,对比文件图26:[0269] 如图所示,驱动器51A连接到电阻53A和52B的配对,驱动器51B连接到电阻53B和52C的配对,驱动器51C连接到电阻53C和52A的配对。每个驱动器连接的电阻配对各不相同。**论述**:目标专利的特征F要求每个驱动器连接到不同的电阻配对。对比文件图26清楚展示了三个差分驱动器(51A, 51B, 51C)分别连接到三组不同的电阻对(53A&52B, 53B&52C, 53C&52A)。因此,该技术特征被对比文件直接公开。
**技术特征G《未公开》**<br>其中所述正端子驱动器和所述负端子驱动器能分开且独立地切换以提供具有幅值和方向的电流。无相应内容。对比文件仅描述了驱动器接收输入并产生输出,未提及正负端子可以独立切换控制电流的幅值和方向。**论述**:目标专利的特征G强调驱动器的正端子和负端子可以分开且独立地切换,以灵活控制电流的幅值和方向,这是实现其功率节省方案(如选择性关闭一端)的基础。对比文件全文(包括图26、27及相应描述)仅将每个差分驱动器作为一个整体单元来描述,其正负端子作为互补输出同时工作,未公开或暗示正负端子可以独立控制其开关状态和电流特性。因此,该技术特征未被公开。
**技术特征H《未公开》**<br>其特征在于,所有电阻元件都具有相同的电阻值。无相应内容。对比文件未提及电阻元件的具体阻值或是否相同。**论述**:目标专利的特征H是具体的电阻值限定。对比文件对图26中的电阻52A-C、53A-C的阻值未作任何说明,本领域技术人员无法从对比文件得出所有电阻值相同的结论。该特征未被公开。
**技术特征I《未公开》**<br>其特征在于,在所述多个差分信号的传输循环期间,所述n个电阻元件中的每一个具有与其他电阻元件不同的幅值和/或方向的电流。无相应内容。对比文件未分析或描述传输期间各个电阻上的电流幅值和方向特性。**论述**:目标专利的特征I定义了在N阶乘差分信令系统有效工作状态下,各电阻上电流的分布特性(互不相同)。对比文件仅关注于通过三条线传输六种状态编码和解码的逻辑与时序,并未涉及端接网络内部各电阻支路上的电流分析,也未提及为实现N!状态所需满足的此类电流条件。因此,该技术特征未被公开。
**技术特征J《未公开》**<br>其特征在于,在传输循环期间耦合到所述n个电阻元件的所述多个差分信号的组合具有非零电压差分。无相应内容。对比文件未提及该电压特性。**论述**:目标专利的特征J是N阶乘差分信令系统避免无效状态(零差分电压)的核心特征。对比文件虽然也使用三线六状态,但其状态选择是为了编码数据和时钟,并未从端接网络电压差分的角度定义或排除“非零电压差分”这一条件。该技术特征未被公开。
**技术特征K《直接公开》**<br>其特征在于,n=>3。对比文件多处,例如:[0003] “...transmit digital data that represent six types of state transitions through three transmission lines.”**论述**:目标专利的特征K限定了导体数量n至少为3。对比文件明确其系统使用三条传输线(three transmission lines),即n=3,这满足n>=3的条件。因此,该技术特征被直接公开。
**技术特征L《未公开》**<br>其特征在于,所述多个差分信号是从原始码元子集生成的,所述原始码元子集选自多个可能原始码元,所述原始码元子集等于在所述端接网络电路处生成非零电压差分的n!个状态。无相应内容。对比文件未提及“n!”个状态的概念或基于非零电压差分选择码元子集的方法。**论述**:目标专利的特征L定义了信号生成源自有n!个状态的子集,这是N阶乘信令的核心数学特征和状态选择准则。对比文件使用固定的6种状态进行编码,这6种状态并非基于“n!(此处n=3,3!=6)”和“非零电压差分”的概念推导或选择出来的,而是为了实现特定的两相或四相数据与时钟复用而设计的编码方案。因此,该技术特征未被公开。
**技术特征M《未公开》**<br>其特征在于,所述正端子驱动器和所述负端子驱动器之一被选择性地关闭以消除跨电阻元件的电流抵消。无相应内容。对比文件未提及选择性关闭驱动器端子或消除电流抵消。**论述**:目标专利的特征M是实现功率节省的关键操作步骤。对比文件全文未描述任何关于为了节省功率而选择性关闭驱动器正端子或负端子的技术手段,也未提及端接网络中存在的电流抵消问题及其解决方案。因此,该技术特征未被公开。
**技术特征N《未公开》**<br>其特征在于,所述多个差分信号驱动器之间的电路径只经过所述n个电阻元件以及所述公共节点。无相应内容。对比文件的驱动器通过三角形电阻网络互连,不存在目标专利所定义的“公共节点”。**论述**:目标专利的特征N限定了驱动器间唯一的电气连接路径。该特征依赖于特征A的星形网络结构(所有电阻共接于一个公共节点)。如特征A所述,对比文件采用三角形网络,驱动器之间通过电阻互连,但路径并不经过一个单一的“公共节点”。因此,该技术特征未被公开。
**技术特征O《直接公开》**<br>其特征在于,对于n=3个导体,使用3个差分信号驱动器以及2个差分电压电平来在每循环传送6个状态。对比文件:[0269] 图26显示了3个差分驱动器(51A, 51B, 51C)。[0270] 图27的真相表显示了输入(OU, OV, OW)与输出(Or, Os, Ot)的对应关系,输出为三值信号(低、中、高),即使用了2个差分电压电平(例如正差分和负差分)。结合[0003]和[0105]可知,系统通过3条线传输6种状态。**论述**:目标专利的特征O给出了n=3时的具体系统参数。对比文件明确公开了:使用3个导体(传输线)、3个差分驱动器(图26)、三值信号即2个差分电压电平(图27真相表隐含)、以及每循环传送6种状态(系统描述)。因此,该技术特征被对比文件直接公开。
**技术特征P《未公开》**<br>其特征在于,对于n=4个导体,使用6个差分信号驱动器以及3个差分电压电平来在每循环传送24个状态。无相应内容。对比文件仅涉及n=3的系统。**论述**:目标专利的特征P是针对n=4的扩展系统的具体参数。对比文件全文仅描述和涉及使用三条传输线(n=3)的系统,未提及或暗示任何关于四条或更多导体的N阶乘端接网络结构及其对应的驱动器数量、电压电平数和状态数。因此,该技术特征未被公开。
**技术特征Q《未公开》**<br>其特征在于,对于n=5个导体,使用10个差分信号驱动器以及4个差分电压电平来在每循环传送120个状态。无相应内容。对比文件仅涉及n=3的系统。**论述**:同特征P,对比文件未涉及n=5或更高阶的系统,该技术特征未被公开。
**技术特征R《未公开》**<br>其特征在于,对于n=6个导体,使用15个差分信号驱动器以及5个差分电压电平来在每循环传送720个状态。无相应内容。对比文件仅涉及n=3的系统。**论述**:同特征P、Q,对比文件未涉及n=6或更高阶的系统,该技术特征未被公开。
**技术特征S《未公开》**<br>其特征在于,每一个正端子驱动器以及每一个负端子驱动器包括多个可切换电路,每一可切换电路独立于同一正/负端子驱动器中的其他可切换电路来控制。无相应内容。对比文件未描述驱动器内部包含多个可独立控制的可切换电路。**论述**:目标专利的特征S涉及驱动器内部为提供不同电流幅值而采用的模块化电路结构。对比文件将差分驱动器(51A等)作为基本功能单元,未揭示其内部结构,更未公开其正端子或负端子驱动器由多个可独立控制的可切换电路构成。因此,该技术特征未被公开。
**技术特征T《未公开》**<br>其特征在于,每一可切换电路包括导致电流流出相应的正/负端子驱动器的第一开关、以及导致电流流入相应的正/负端子驱动器的第二开关。无相应内容。对比文件未描述此类开关结构。**论述**:目标专利的特征T是特征S中可切换电路的具体实现方式。由于对比文件未公开特征S,自然也未公开这种具体的包含推挽开关的可切换电路结构。该技术特征未被公开。
**技术特征U《未公开》**<br>其特征在于,所述多个可切换电路包括提供去往/来自相应端子的第一电流的第一可切换电路以及提供去往/来自相应端子的第二电流的第二可切换电路。无相应内容。对比文件未描述驱动器提供不同幅值电流的电路。**论述**:目标专利的特征U限定了可切换电路提供不同电流。对比文件未公开驱动器内部有提供不同电流幅值的多个电路模块。该技术特征未被公开。
**技术特征V《未公开》**<br>其特征在于,所述第二电流具有与所述第一电流不同的幅值但相同的方向。无相应内容。对比文件未涉及电流幅值的设置。**论述**:目标专利的特征V限定了不同电路提供不同幅值但同向的电流。对比文件未公开相关内容。该技术特征未被公开。
**技术特征W《未公开》**<br>其特征在于,所述第二电流是所述第一电流的整数倍。无相应内容。对比文件未涉及电流幅值的比例关系。**论述**:目标专利的特征W限定了电流间的整数倍关系。对比文件未公开相关内容。该技术特征未被公开。
**技术特征X《未公开》**<br>其特征在于,所述多个可切换电路还包括提供去往/来自相应端子的第三电流的第三可切换电路,其中所述第二电流相比于所述第一电流具有固定增量,而所述第三电流相比于所述第二电流具有相同的固定增量。无相应内容。对比文件未涉及具有固定增量的多个电流电路。**论述**:目标专利的特征X限定了多个可切换电路提供具有固定增量的电流。对比文件未公开相关内容。该技术特征未被公开。
**技术特征Y《未公开》**<br>其特征在于,可切换电路的幅值和/或数量是所使用的导体数量的函数。无相应内容。对比文件未将驱动器电路设计与导体数量n关联。**论述**:目标专利的特征Y概括了驱动器电路配置与系统规模(导体数n)之间的函数关系。对比文件仅固定描述n=3的系统,未揭示或暗示这种通用的设计规则。该技术特征未被公开。

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